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高速PCB设计中的常见问题及解决方法
   编辑:   浏览:1191  时间:2014-06-10 

随着器件工作频率越来越高,高速PCB设计所面临的信号完整性等问题成为传统设?#39057;?#19968;个瓶颈,工程师在设计出完整的解决方案上面临越来越大的挑战。尽管有关的高速仿真工具和互连工具可以帮助设计设计师解决部分难题,但高速PCB设计中也更需要经验的不断积累及业界间的深入交流。

下面列举的是其中一些广受关注的问题。
布线拓朴对信号完整性的影响
当信号在高速PCB板上沿传输线传输时可能会产生信号完整性问题。意法半导体的网友tongyang问:对于一组总线(地址,数据,命令)驱动多达4、5个设备(FLASH、SDRAM等)的情况,在PCB布线时,是总线?#26469;?#21040;达各设备,如先连到SDRAM,再到FLASH……还是总线?#24066;切头?#24067;,即从某处分离,分别连到各设备。这两种方式在信号完整性上,哪种较好?

对此,李宝龙指出,布线拓扑对信号完整性的影响,主要?#20174;?#22312;各个节点上信号到达时刻不一致,反射信号同样到达某节点的时刻不一致,所以造成信号质量恶化。一般来讲,星型拓扑结构,可以通过控制同样长的几个分支,使信号传输?#22836;?#23556;时延一致,达到比较好的信号质量。在使用拓扑之间,要考虑到信号拓扑节点情况、?#23548;?#24037;作原理和布线难度。不同的Buffer,对于信号的反射影响也不一致,所以星型拓扑并不能很好解决上述数据地址总线连接到FLASH和SDRAM的时延,进而无法确保信号的质量;另一方面,高速的信号一般在DSP和SDRAM之间通信,FLASH加载时的速率并不高,所以在高速仿真时只要确保?#23548;?#39640;速信号有效工作的节点处的波形,而无需关注FLASH处波形;星型拓扑比较菊花链等拓扑来讲,布线难度较大,尤其大量数据地址信号都采用星型拓扑时。

焊盘对高速信号的影响
在PCB中,从设?#39057;?#35282;度来看一个过孔主要由两部分组成:中间的钻孔和钻孔周围的焊盘。有名为fulonm的工程师请教嘉宾焊盘对高速信号有何影响,对此,李宝龙表示:焊盘对高速信号有影响,其影响类似器件的封装对器件的影响。详细的分析,信号从IC内出来以后,经过邦定线、管脚、封装外壳、焊盘、焊锡到达传输线,这个过程中的所有关节都会影响信号的质量。但?#23548;?#20998;析时,很难给出焊盘、焊锡加上管脚的具体?#38382;?#25152;以一般就用IBIS模型中的封装的?#38382;?#23558;他们?#20960;?#25324;了,当然这样的分析在?#31995;?#30340;频率上可?#36234;?#25910;,但对于更高频?#24066;?#21495;更高精度仿真就不够精确。现在的一个趋势是用IBIS的V-I、V-T曲线描述Buffer特性,用SPICE模型描述封装?#38382;?/P>

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